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數字電子技術(shù)基礎期末考試題
數字電子技術(shù)基礎學(xué)的是什么？期末會(huì )考什么呢？下面是小編為大家收集整理的數字電子技術(shù)基礎相關(guān)內容，歡迎閱讀。
數字電子技術(shù)基礎期末考試題
一、單項選擇題(每小題1分，共10分)
1、以下描述一個(gè)邏輯函數的方法中，( )只能唯一表示。
A.表達式 B.邏輯圖 C.真值表 D.波形圖
2、在不影響邏輯功能的情況下，CMOS與非門(mén)的多余輸入端可( )。
A.接高電平 B.接低電平 C.懸空 D.通過(guò)電阻接地
3、一個(gè)八位二進(jìn)制減法計數器，初始狀態(tài)為00000000，問(wèn)經(jīng)過(guò)268個(gè)輸入脈沖后，此計數器的狀態(tài)為( )。
A.11001111 B.11110100 C.11110010 D.11110011
4、若要將一異或非門(mén)當作反相器(非門(mén))使用，則輸入端A、B端的連接方式是( )。
A.A或B中有一個(gè)接“1” B.A或B中有一個(gè)接“0”
C.A和B并聯(lián)使用 D.不能實(shí)現
5、在時(shí)序電路的狀態(tài)轉換表中，若狀態(tài)數N=3，則狀態(tài)變量數最少為( )。
A.16 B.4 C.8 D.2
6、下列幾種TTL電路中，輸出端可實(shí)現線(xiàn)與功能的門(mén)電路是( )。
A.或非門(mén) B.與非門(mén) C.異或門(mén) D.OC門(mén)
7、下列幾種A/D轉換器中，轉換速度最快的是( )。
A.并行A/D轉換器 B.計數型A/D轉換器
C.逐次漸進(jìn)型A/D轉換器 D.雙積分A/D轉換器
8、存儲容量為8K×8位的ROM存儲器，其地址線(xiàn)為( )條。
A.8 B.12 C.13 D.14
9、4個(gè)觸發(fā)器構成的8421BCD碼計數器，共有( )個(gè)無(wú)效狀態(tài)。
A.6 B.8 C.10 D.12
10、以下哪一條不是消除竟爭冒險的措施( )。
A.接入濾波電路 B.利用觸發(fā)器
C.加入選通脈沖 D.修改邏輯設計
二、填空題(每空1分，共20分)
1、時(shí)序邏輯電路一般由（ ）和( )兩分組成。
2、多諧振蕩器是一種波形產(chǎn)生電路，它沒(méi)有穩態(tài)，只有兩個(gè)
3、數字電路中的三極管一般工作于________區和________區。
4、四個(gè)邏輯變量的最小項最多有________個(gè)，任意兩個(gè)最小項之積為_(kāi)_______。
5、555定時(shí)器是一種用途很廣泛的電路，除了能組成________觸發(fā)器、________觸發(fā)
器和________三個(gè)基本單元電路以外，還可以接成各種實(shí)用電路。
6、用2048×12的ROM芯片，最多能實(shí)現________個(gè)輸入________個(gè)輸出的組合邏輯
函數。
7、對于JK觸發(fā)器，若J=K，則可完成________觸發(fā)器的邏輯功能;若K=J=1，則完成
________觸發(fā)器的邏輯功能。
8、時(shí)序邏輯電路的輸出不僅和_________有關(guān)，而且還與________有關(guān)。
9、三態(tài)門(mén)的輸出狀態(tài)有________、低電平、________三種狀態(tài)。
10、采用ISP技術(shù)的PLD是先裝配，后________。
11、轉換速度|和______________是衡量A/D轉換器和D/A轉換器性能優(yōu)劣的主要指標。
三、簡(jiǎn)答題(每小題5分，共15分)
1、證明邏輯函數式： BC ? D ? D(B ? C )(AD ? B) ? B ? D。
2、簡(jiǎn)述下圖所示組合邏輯電路的功能。
3、試述施密特觸發(fā)器和單穩態(tài)觸發(fā)器的工作特點(diǎn)。
四、分析設計題(共30分)
1、試列寫(xiě)下列 ROM結構中Y2、Y1、Y0的函數表達式，并采用八選一數據選擇器 74LS152對Y2、Y1、Y0重新實(shí)現。要求寫(xiě)出實(shí)現表達式，并畫(huà)出邏輯電路圖。其中，ROM地址譯碼器中，輸入地址選中的列線(xiàn)為高電平。(10分)
2、試用 JK觸發(fā)器和門(mén)電路設計一個(gè)十三進(jìn)制的計數器，要求體現邏輯抽象、狀態(tài)化簡(jiǎn)、狀態(tài)方程、特性方程、驅動(dòng)方程和輸出方程等中間過(guò)程，畫(huà)出邏輯電路圖，并檢查所設計的電路能否自啟動(dòng)。(20分)
參考答案
一、單項選擇題。
1-5 CABBD
6-10 DACAB
二、填空題。
1、存儲電路，組合電路
2、暫穩態(tài)
3、截止，飽和
4、16，0
5、施密特，單穩態(tài)，多諧振蕩器
6、11，12
7、T，T′
8、該時(shí)刻輸入變量的取值，電路原來(lái)的狀態(tài)
9、高電平，高阻態(tài)
10、編程
11、轉換精度
三、簡(jiǎn)答題
1、略
2、解：該電路為三人表決電路，只要有 2票或 3票同意，表決就通過(guò)。
3、解：
施密特觸發(fā)器：(1)輸入信號從低電平上升的過(guò)程中，電路狀態(tài)轉換時(shí)對應的輸入電平，
與輸入信號從高電平下降過(guò)程中對應的輸入轉換電平不同;(2)在電路狀態(tài)轉換時(shí)，通過(guò)電
路內部的正反饋過(guò)程使輸出電壓波形的邊沿變得很陡。
單穩態(tài)觸發(fā)器：(1)有穩態(tài)、暫穩態(tài)兩個(gè)狀態(tài);(2)在外界觸發(fā)脈沖作用下，能從穩態(tài)
翻轉到暫穩態(tài)，暫穩態(tài)持續一段時(shí)間后，自動(dòng)回到穩態(tài);(3)暫穩態(tài)持續時(shí)間的長(cháng)短取決于
電路本身參數，與觸發(fā)脈沖的寬度和幅度無(wú)關(guān)。
四、分析設計題
1、略
2、略
延伸閱讀：數字電子技術(shù)基礎復習知識點(diǎn)
觸發(fā)器按邏輯功能的分類(lèi)
一.RS觸發(fā)器
Qn+1=S+RQn
SR=0（約束條件）
二.JK觸發(fā)器
Qn+1=JQn+KQn
三.T觸發(fā)器
Qn+1=TQn+TQn
JK觸發(fā)器的兩個(gè)輸入端連接在一起作為T(mén)端，就可以構成T觸發(fā)器。
當T觸發(fā)器的控制端接至固定的高電平時(shí)，每次CP信號作用后必然翻轉成與初態(tài)相反的狀態(tài)。
Qn+1=Qn
四.D觸發(fā)器
Qn+1=D
時(shí)序電路分析
1.從給定的邏輯圖中寫(xiě)出每個(gè)觸發(fā)器的驅動(dòng)方程
2.把得到的驅動(dòng)方程代入相應的觸發(fā)器特性方程，得出每個(gè)觸發(fā)器的狀態(tài)方程，從而組成狀態(tài)方程組。
3.根據電路圖寫(xiě)出輸出方程。
2.分析圖4-7所示電路的邏輯功能。
（1）寫(xiě)出驅動(dòng)方程、狀態(tài)方程
（2）作出狀態(tài)轉移表、狀態(tài)轉移圖
（3）指出電路的邏輯功能，并說(shuō)明能否自啟動(dòng)
試分析圖4-9下面時(shí)序邏輯電路
（1）寫(xiě)出該電路的驅動(dòng)方程，狀態(tài)方程和輸出方程
（2）畫(huà)出Q1Q0的狀態(tài)轉換圖
（3）根據狀態(tài)圖分析其功能
任意進(jìn)制計數器的構成方法
假定已有N進(jìn)制計數器，需要得到M進(jìn)制計數器。這時(shí)有M＞N和M＜N兩種情況（M＞N這里不做講解）
M＜N時(shí)，在N進(jìn)制計數器的順序計數過(guò)程中要設法跳越N-M個(gè)狀態(tài)，就可以得到M進(jìn)制計數器了。
方法有置零法和置數法兩種。
置零法適用于有異步置零輸入端的計數器。它是從S0開(kāi)始計數并接收了M個(gè)計數脈沖以后，電路進(jìn)入Sm狀態(tài)產(chǎn)生了一個(gè)置零信號加到計數器的異步置零輸入端，計數器立刻返回S0狀態(tài)。這樣實(shí)現跳越N-M個(gè)狀態(tài)。
置數法是通過(guò)給計數器重復置入某個(gè)數值來(lái)實(shí)現跳越N-M個(gè)狀態(tài)，從而得到M進(jìn)制計數器。
3.十六進(jìn)制計數器74161的邏輯符號如圖4-27（a）所示，功能如表4-1。要求構成十進(jìn)制計數器，其十個(gè)循環(huán)狀態(tài)如圖4-27（b）所示。請畫(huà)出接線(xiàn)圖，可以增加必要的門(mén)。
時(shí)序電路的設計方法
一、邏輯抽象，得出電路的狀態(tài)轉換圖或狀態(tài)轉換表
1.分析給定的邏輯問(wèn)題，確定輸入變量、輸出變量以及電路的狀態(tài)數。
2.定義輸入、輸出邏輯狀態(tài)和每個(gè)電路狀態(tài)的含義，并將電路狀態(tài)順序編號。
3.依題意列出電路的狀態(tài)轉換圖或狀態(tài)轉換表。
二、狀態(tài)化簡(jiǎn)
若兩個(gè)電路狀態(tài)在相同的輸入下有相同的輸出，并且轉換到同一個(gè)次態(tài)去，則稱(chēng)這兩個(gè)狀態(tài)為等價(jià)狀態(tài)。
狀態(tài)化簡(jiǎn)的目的在于將等價(jià)狀態(tài)合并，以求得最簡(jiǎn)的狀態(tài)轉換圖。
三、狀態(tài)分配
時(shí)序邏輯電路的狀態(tài)是用觸發(fā)器狀態(tài)的不同組合來(lái)表示的。需要確定觸發(fā)器的數目n。因為n的觸發(fā)器共有2n種狀態(tài)組合，所以為獲得時(shí)序電路所需的M個(gè)狀態(tài)，必須取2n-1＜M≤2n。
其次，要給每個(gè)電路狀態(tài)規定對應的觸發(fā)器狀態(tài)組合。
四、選定觸發(fā)器的類(lèi)型，求出電路的狀態(tài)方程，驅動(dòng)方程和輸出方程
五、根據得到的方程式畫(huà)出邏輯圖
六、檢查設計的電路能否自啟動(dòng)
可以利用無(wú)關(guān)項檢查能否自啟動(dòng)，將無(wú)關(guān)項代入狀態(tài)轉換圖當中。
4．試用D觸發(fā)器設計一個(gè)同步五進(jìn)制加法計數器，要求寫(xiě)出設計過(guò)程。
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